Vivado 2018.3生成比特流消耗大量时间

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我正在使用Vivado 2018.3(在Ubuntu 22.04上)我的项目是关于pcie xdma的,不是很大的项目。
syn和执行部分大约需要5分钟,并且报告时间失败。
但无论如何我想生成比特流。生成它需要将近 1-2 小时,系统监视器显示 cpu 核心和内存几乎无法在大负载下工作(cpu 5%,内存 30%),这很奇怪!

一些尝试:
1.我修改了时序约束,它有帮助,但是当我改变我的设计(例如添加ILA)时,生成比特流的时间仍然从2分钟变成2小时
2.我是版本bug,我需要下载另一个版本来验证一下
3.我的Linux环境有问题,它丢失了一些驱动程序或lib导致这个问题

linux fpga vivado
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问题解决了:我把版本改成2019.2了,一切OK了

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